zhangjin 4年前提问 Tessent PrimeTime
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合适的 level , edge , transition 的 参数设置

请教个问题, DFT 工具产生pattern 转换到 ATE 上时 , 会有 level setup , timing setup (包括 driver 的 edge , compare edge 等等 ),vector setup等 ,

那么 这些 level , edge , transition的组合 会有很多种情况, 即这些参数的设置值是多少的情况下 pattern 的 质量或者说 产品的良率最高 ?

在ATE 或者 TE engineer的角度, 可以做shmoo , pin margin 去找到合适的 timing level 设置;
请问 如果从 DFT 的角度 (或者说从design的角度) 可以做哪些工作 , 来找到合适的 level , edge , transition 的 参数设置 呢 ????

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芯片测试DFT实战
懂概念,会工具,熟流程,动手做 1949
小子AJ 2年前回复
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DFT工程师一般会和Timing工程师,Test工程师一起讨论ATE的设置,比如你提到的timeplate。但是没有精细到edge,transition这种。

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